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| LEADER |
03905nmm a2200361 u 4500 |
| 001 |
EB002137553 |
| 003 |
EBX01000000000000001275680 |
| 005 |
00000000000000.0 |
| 007 |
cr||||||||||||||||||||| |
| 008 |
230102 ||| ger |
| 020 |
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|a 9783031181740
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| 100 |
1 |
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|a Herdt, Vladimir
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| 245 |
0 |
0 |
|a Verbessertes virtuelles Prototyping
|h Elektronische Ressource
|b Mit RISC-V-Fallstudien
|c von Vladimir Herdt, Daniel Große, Rolf Drechsler
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| 250 |
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|a 1st ed. 2022
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| 260 |
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|a Cham
|b Springer International Publishing
|c 2022, 2022
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| 300 |
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|a XXIV, 262 S. 93 Abb., 65 Abb. in Farbe
|b online resource
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| 505 |
0 |
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|a Einleitung -- Vorbemerkungen -- Eine quelloffene RISC-V-Evaluierungsplattform -- Formale Verifikation von SystemC-basierten Entwürfen mittels symbolischer Simulation -- Abdeckungsgesteuertes Testen für die skalierbare Verifikation von virtuellen Prototypen -- Verifikation von eingebetteten Software-Binärdateien mittels virtueller Prototypen -- Validierung von Firmware-basiertem Power Management mittels virtueller Prototypen -- Korrespondenzanalyse auf Register-Transfer-Ebene -- Fazit -- Index
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| 653 |
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|a Embedded Systems
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| 653 |
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|a Embedded computer systems
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| 653 |
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|a Electronic circuits
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| 653 |
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|a Cyber-Physical Systems
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| 653 |
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|a Electronic Circuits and Systems
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| 653 |
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|a Cooperating objects (Computer systems)
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| 700 |
1 |
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|a Große, Daniel
|e [author]
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| 700 |
1 |
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|a Drechsler, Rolf
|e [author]
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| 041 |
0 |
7 |
|a ger
|2 ISO 639-2
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| 989 |
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|b Springer
|a Springer eBooks 2005-
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| 028 |
5 |
0 |
|a 10.1007/978-3-031-18174-0
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| 856 |
4 |
0 |
|u https://doi.org/10.1007/978-3-031-18174-0?nosfx=y
|x Verlag
|3 Volltext
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| 082 |
0 |
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|a 6,213,815
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| 520 |
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|
|a Darüber hinaus legt das Buch einen besonderen Schwerpunkt auf den modernen RISC-V ISA, mit mehreren Fallstudien, die sowohl Aspekte derModellierung als auch der VP- und SW-Verifikation abdecken. Ermöglicht die Verbesserung aller wichtigen Aspekte eines Virtual Prototype (VP)-basierten Designablaufes. Umfasst automatisierte formale Verifikationsmethoden und fortgeschrittene abdeckungsgeleitete Testverfahren,die auf SystemC-basierte VPs zugeschnitten sind. Beschreibt effiziente, abdeckungsgeleitete Testgenerierungsmethoden für VP-basierte funktionale und nicht-funktionale Software (SW) Analyse und Verifikation. Enthält Korrespondenzanalysen zur Nutzung von Informationen zwischen verschiedenen Abstraktionsebenen. Verwendet mehrere VP- und SW-Verifikationsfallstudien entsprechend der modernen RISC-V ISA. Die Übersetzung wurde mit Hilfe von künstlicher Intelligenz (anhand einer maschinellen Übersetzung durch einen Service von DeepL.com) angefertigt.
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| 520 |
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|a Dieses Buch stellt eine umfassende Reihe von Techniken vor, die alle wichtigen Aspekte eines modernen Virtual Prototype (VP)-basierten Entwurfsablaufs verbessern. Die Autoren legen den Schwerpunkt auf automatisierte formale Verifikationsmethoden sowie auf fortgeschrittene, abdeckungsgeleitete Analyse- und Testtechniken, die auf SystemC-basierte VP und die zugehörige Software (SW) zugeschnitten sind. Die Abdeckung umfasst auch VP-Modellierungstechniken, die sowohl funktionale als auch nicht-funktionale Aspekte behandeln, und beschreibt auch Korrespondenzanalysen zwischen der Hardware- und VP-Ebene, um die auf verschiedenen Abstraktionsebenen verfügbaren Informationen zu nutzen. Alle Ansätze werden ausführlich diskutiert und anhand mehrerer Experimente evaluiert, um ihre Effektivität bei der Verbesserung des VP-basierten Entwurfsablaufs zu demonstrieren.
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| 520 |
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|a Da die anschließende Überprüfung hauptsächlich im Hinblick auf inhaltliche Gesichtspunkte erfolgte, kann sich der Text des Buches stilistisch von einer konventionellen Übersetzung unterscheiden. Springer Nature arbeitet bei derPublikation von Büchern kontinuierlich mit innovativen Technologien, um die Arbeit der Autoren zu unterstützen
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